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基于单片机和DSP实现高速信号采集和远程采集控制系统的设计

电子设计 ? 2019-01-20 09:28 ? 次阅读
标签:入土 mg电子游戏试玩 东大街道

1 引言

数据采集技术是一项基本的实用性技术,已被广泛地应用于测量、检测、控制、诊断等各个领域。随着电子技术, 计算机技术和通信技术的迅猛发展, 国内外用数字信号处理的办法检测, 采集, 分析, 处理各种数据已经成为一种趋势,而运用数字信号处理的方法对现场采集的音频信号进行实时分析,为现场状况的预测提供精确的数据分析依据,现己经在故障检测、灾害预防、军事等方面得到了广泛的应用。在铝电解工业中,确认电解槽的破损形式和部位时可利用其发出的信号进行检测。在铝电解的生产过程中会产生一些特征频率,如熔体循环流动、界面波动、阳极气体排出等等,也可以利用这些信号所传达的信息实时检测进行故障预防。本设计的功能是采集铝电解槽的20kHz 以下频率信号即音频信号缓冲存储并实时上传到PC 机并且接收PC 机传来的指挥信号。

2 系统总体结构设计

单片机工作频率较低, 其信号处理能力远远不及DS P , 但是它拥有丰富的接口, 本设计中用到了较多芯片, 其初始化控制协调运行等需要较多的接口, 所以选择单片机作为主机控制所有芯片。DSP 主频为100MHz肯定达到处理要求,外扩的64k SRAM 为语音滤波等算法提供了空间。在与PC 机的通讯中,DSP 没有内置任何通讯模块, 单片机内置了串口通讯, 但对于高速信号采集和远程采集控制来讲串口显然不符合要求,所以本设计采用了瑞立公司的网络通讯芯片8019 通过网线与PC 机进行通信,它遵守TCP/IP 和UDP 协议,从而使该系统可以通过网络进行远程控制,理论上要求传输速度为96k*32 位*2 加开销大约为8M/s,五类双绞网线带宽为10M,传输距离200 米,可以达到电解槽现场要求。

系统总体架构如图1 所示,由单片机通过DSP 的主机接口HPI 控制DSP 的加载启动和复位, 单片机控制AD 模块AIC23 的初始化和复位,同时也控制网络通讯模块8019 的上电复位,通过串口RS232 可以将程序下载到单片机中。DSP 则通过多通道缓冲串口McBSP 与AIC23 进行数据交换,同时通过网络模块8019 与上位机进行数据通信,SRAM 则为DSP 的数据存储和处理提供了更广阔的空间。另外CPLD 模块并未在图中表示出,所有需要逻辑的信号都要通过CPLD 模块进行逻辑,如片选信号, 地址译码信号, 一部分复位信号等等。

基于单片机和DSP实现高速信号采集和远程采集控制系统的设计

图1 系统总体架构图

2.1 主从结构设计

系统由单片机和DS P 组成主从结构, 单片机为主机,主要通过DSP 的HPI 外设对DSP 进行控制,该外设包括HD[0-7] 八个数据线和十个控制引脚,用单片机的P0 口连接DSP 的HD 口,P2 口连接需要控制的几个控制引脚,这样通过P0 口和P2 口,单片机就可以通过HPI实现对DSP 的控制,事实上主要是上电复位的bootloader引导过程。单片机对DSP 的启动控制过程是首先上电发复位信号,DSP 上电复位后30 个CPU 周期内会首先检查INT2 中断标志是否有效,将HPI 的HINT 引脚连接到INT2 上,这样DSP 复位后HINT 的低电平使INT2有效,正好选择了HPI 模式,待DSP 完成了对HPI 实现方式的确认后向DSP 装载程序,程序搬移完成后设置程序入口点,这样就实现了DSP 的启动。

2.2 DSP 与AIC23 的通信

DSP 与AIC23 间的通信是通过McBSP[6]口实现的,它是一个多通道多缓冲全双工的串行通信接口,AIC23通过单片机配置可以实现8kHz-96kHz 的采样率[4],根据采样定理采样率需要达到40kHz 以上,将AIC23 配置为96kHz 的采样率。硬件连接方案如下:将DSP 的BDX0(发送串行数据)BDR0(接收串行数据)BFSX0(发送帧同步引脚)BFSR0(接收帧同步引脚)与AIC23 的DIN(接收串行数据)DOUT(发送串行数据)LRCIN(接收帧同步信号)LRCOUT(发送帧同步信号)相连接。因为整个通信过程是由DSP 主导的,所以时钟信号统一用BCLKX0(发送时钟引脚),故而将BCLKX0 BCLKR0(接收时钟引脚)以及AIC23 上的BCLK 相连。

2.3 DSP 与8019 的通信

对于DS P 来讲, 8 0 1 9 好比一个片外存储器, 所以DSP 对8019 的操作与对片外存储器的操作相同,连接方法也与存储器连接方法相同, 这里不再螯述, 事实上,8019 内部存储器分为三部分即控制寄存器和数据发送接收存储器。

3 系统软件设计

3.1 单片机程序设计

单片机控制着整个系统,主要工作是各个芯片的上电复位初始化, 对于不同的芯片操作方式也不尽相同,程序设计中将每个芯片初始化定义为一个函数,其主函数如下:

基于单片机和DSP实现高速信号采集和远程采集控制系统的设计


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对DSP 的初始化过程分为复位和加载程序两步,完成初始化后通过AIC23 放音。

3.2 DSP 程序设计

DSP 程序包括主程序,AD 控制程序,8019 控制程序,中断向量表和命令文件。主程序中完成对自身各寄存器的配置和外围芯片的二次初始化以及死循环,需要配置的自身寄存器包括几个基本状态寄存器,定时器有关寄存器和多通道缓冲串口寄存器。AD 控制程序包含于McBSP 接收中断服务程序中,该程序将接收到的信号存储到一个定义好的缓存中,同时将发送缓存中的一个信号送给AD。程序如下:

基于单片机和DSP实现高速信号采集和远程采集控制系统的设计

基于单片机和DSP实现高速信号采集和远程采集控制系统的设计



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8019 控制程序是最繁琐的一部分,因为编程过程要遵循TCP/IP 和UDP 协议,8019 具有独特的分页控制寄存器的功能。可以将复杂的控制程序分为几个控制函数, 好在制造商已经为用户提供了这几个函数的库文件,用户只需要调用就可以了,以下给出8019 通信程序:

基于单片机和DSP实现高速信号采集和远程采集控制系统的设计


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基于单片机和DSP实现高速信号采集和远程采集控制系统的设计

3.3 CPLD 程序设计

CPLD 程序中要完成的有片选信号(包括一部分地址信号)和中断信号的逻辑处理,选用ALTRA 的EPM7032AE[5]。

DSP 的外部中断INT1 反映的是USB 中断请求,INT1 为低有效而USBINT 为高有效,INT1<=NOT(USBINT);DSP 的RW 信号在读操作时为高电平在写操作时为低电平,MEMSTRB 存储器选通信号为低有效,SRAM 的写信号MEMWR 和读信号MEMRD 均为低有效, 故MEMWR<=RW OR MEMSTRB,MEMRD<=NOT (RW)OR MEMSTRB;DSP 的I/O 选通信号IOSTRB 为低有效, 而对于接受I /O 控制的USB 芯片来讲其读写信号RD 和WR 均为低有效,故IOWR<=RW OR IOSTRB,IORD<=NOT(RW) OR IOSTRB;DSP 的数据选通信号DS 为低有效,存储器选通信号MEMSTRB 也为低有效,而SRAM的片选信号RAMCS 同样为低有效,并且RAMCS在DS 或MEMSTRB 有效时均应被激活,RAMCS<=MEMSTRB OR DS;3.4 上位机程序设计:

上位机程序的功能是接收来自下位机的传送数据和向下位机发送数据和命令,对于接受到的数据可以利用数据分析系统进行分析得出结果,而对于向下位机发送的数据工业中以控制参数和音频命令居多,故本设计中上位机界面提供了这些内容, 界面如图2 所示。

基于单片机和DSP实现高速信号采集和远程采集控制系统的设计

图2 上位机界面。

3.5 调试

图3 抓包测试图。

电路板制作完成后, 用联机网线将电路板和PC 机连接,将电路板IP 和PC 机IP 设置在同一组中,从PC 机发送包含0-20kHz 各个频率的音频信号给DSP,DSP 将该音频通过AIC23 后播放,与PC 机同步播放的音频信号相对比检查传输实时性, 对比其各部分频率或对比PC 机内和DSP 内数据数值可知数据传输质量如何。同时DSP 将采集到的信号发送给PC 机,由于数量很大全部显示反应迟缓所以捕捉显示,对比CCS 查看到的DSP内存储数据可知传输是否正确,用网络抓包软件抓包可以清楚的看到通信的内容, 如图3 所示。

4 结束语

系统设计完成后通过测试能够完成高速信号的采集和传输, 数据传输正确, 质量良好。数据传输的实时性和可靠性达到用户的设计要求。在该系统的设计中,DSP 的强大运算能力和扩展的数据存储空间为复杂算法的实现提供了条件。在铝电解工业应用中,后续课题中将把电解铝控制的复杂神经网络算法写入到本设计的DSP 中,届时该设计的功能可将现场信号采集实时运算及控制以及上传下载高速信号集于一身。此外,在其它工控场合本设计也可扮演重要角色。


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单片机教程之单片机应用系统的设计与实例资料说明

本文档的主要内容详细介绍的是单片机教程之单片机应用系统的设计与实例资料说明主要内容包括了:1 单片机....

发表于 12-18 16:48 ? 46次 阅读
单片机教程之单片机应用系统的设计与实例资料说明

STC12系列单片机如何进行精确定时的详细资料说明

全部都是本人通过示波器反复测量得到1~255倍内精确延时。误差绝对不会超过5%。仅限STC12系列的....

发表于 12-18 16:48 ? 40次 阅读
STC12系列单片机如何进行精确定时的详细资料说明

高水平单片机工程师养成记

对于嵌入式系统来讲,嵌入式软件相当于嵌入式系统的灵魂,整个嵌入式系统如何工作,都是由嵌入式软件来控制....

的头像 单片机精讲吴鉴鹰 发表于 12-18 16:16 ? 233次 阅读
高水平单片机工程师养成记

STC89C52单片机电子密码锁源程序的详细资料说明

本文档的主要内容详细介绍的是STC89C52单片机电子密码锁源程序的详细资料说明。

发表于 12-18 16:11 ? 43次 阅读
STC89C52单片机电子密码锁源程序的详细资料说明

单片机的抗干扰措施有哪些

外时钟是高频的噪声源,除能引起对本应用系统的干扰之外,还可能产生对外界的干扰,使电磁兼容检测不能达标....

发表于 12-18 15:50 ? 83次 阅读
单片机的抗干扰措施有哪些

基于树莓派和openHAB2的家庭设备控制平台设计详解

本项目开发了一种家庭设备控制平台,提供家庭环境的实时监控功能(温度、湿度、火灾报警),提供安防功能(....

发表于 12-18 15:39 ? 155次 阅读
基于树莓派和openHAB2的家庭设备控制平台设计详解

如何让SPI nRF24L01无线在两个单片机里实现通信

main.c 1 #include 2 #include“2401.h” 3 ....

发表于 12-18 15:17 ? 84次 阅读
如何让SPI nRF24L01无线在两个单片机里实现通信

单片机驱动蜂鸣器产生警报声的设计

//实验目的: //熟悉使用单片机驱动蜂鸣器产生警报声 //**************....

发表于 12-18 15:14 ? 123次 阅读
单片机驱动蜂鸣器产生警报声的设计

TMS320VC5506 TMS320VC5506 Fixed-Point Digital Signal Processor

TMS320VC5506定点数字信号处理器(DSP)基于TMS320C55x DSP生成CPU处理器内核。 C55x™DSP架构通过增加并行性和全面关注降低功耗来实现高性能和低功耗。 CPU支持内部总线结构,该结构由一个程序总线,三个数据读总线,两个数据写总线以及专用于外设和DMA活动的附加总线组成。这些总线能够在一个周期内执行最多三次数据读取和两次数据写入。并行地,DMA控制器每个周期最多可以执行两次数据传输,与CPU活动无关。 C55x CPU提供两个乘法累加(MAC)单元,每个单元能够支持17位x 17-单个循环中的位乘法。额外的16位ALU支持中央40位算术/逻辑单元(ALU)。 ALU的使用受指令集控制,提供优化并行活动和功耗的能力。这些资源在C55x CPU的地址单元(AU)和数据单元(DU)中进行管理。 C55x DSP代支持可变字节宽度指令集,以提高代码密度。指令单元(IU)从内部或外部存储器执行32位程序提取,并为程序单元(PU)排队指令。程序单元解码指令,将任务指向AU和DU资源,并管理完全受保护的管道。预测分支功能可避免执行条件指令时的管道冲洗。 5506上的128...

发表于 10-17 14:24 ? 0次 阅读
TMS320VC5506 TMS320VC5506 Fixed-Point Digital Signal Processor

TMS320C6747 定点/浮点数字信号处理器

TMS320C6745 /6747器件是一款基于TMS320C674x DSP内核的低功耗数字信号处理器。它的功耗显着低于TMS320C6000 DSP平台的其他成员。 TMS320C6745 /6747器件使原始设备制造商(OEM)和原始设计制造商(ODM)能够快速推出市场上的设备。高处理性能。 TMS320C6745 /6747 DSP内核采用基于缓存的两级架构。 1级程序高速缓存(L1P)是32 KB直接映射高速缓存,1级数据高速缓存(L1D)是32 KB双向组关联高速缓存。 2级程序高速缓存(L2P)由256 KB内存空间组成,在程序和数据空间之间共享。 L2内存可以配置为映射内存,缓存或两者的组合。虽然系统中的其他主机可以访问DSP L2,但是其他主机可以使用额外的128KB RAM共享内存(仅限TMS320C6747),而不会影响DSP性能。 外设集包括:带管理数据输入/输出(MDIO)模块的10/100 Mbps以太网MAC(EMAC);两个I 2 C总线接口; 3个多通道音频串行端口(McASP),带有16/9串行器和FIFO缓冲器;两个64位通用定时器,每个都可配置(一个可配置为看门狗);可配置的16位主机端口接口(HPI)[仅限TMS3...

发表于 10-17 14:20 ? 20次 阅读
TMS320C6747 定点/浮点数字信号处理器

TMS320C6746 TMS320C6746 Fixed/Floating Point DSP

TMS320C6746定点和浮点DSP是一款低功耗应用处理器,该处理器基于C674x DSP内核。该DSP与其他TMS320C6000™平台DSP相比,功耗要小很多。 凭借这款器件,原始设备制造商(OEM)和原始设计制造商(ODM)能够充分利用全集成混合处理器解决方案的灵活性,迅速将兼用稳健操作系统,丰富用户接口和高处理器性能的器件推向市场。 该器件的DSP内核采用基于2级缓存的架构。第1级程序缓存(L1P)是一个 32KB的直接映射缓存,第1级数据缓存(L1D)是一个32KB的2路组相连缓存。第2级程序缓存(L2P)包含256KB的存储空间,由程序空间和数据空间共享.L2存储器可配置为映射存储器,缓存或二者的组合。系统内的其他主机可以访问DSP L2。 外设集包括:1个具有管理数据输入/输出模块(MDIO)的10Mbps /100Mbps以太网介质访问控制器(EMAC); 1个USB2.0 OTG接口; 2个I 2 C总线接口; 1个具有16个串行器和FIFO缓冲器的多通道音频串行端口(McASP) ); 2个具有FIFO缓冲器的多通道缓冲串行端口(McBSP); 2个可配置的64位通用定时器(其中一个可配置...

发表于 10-15 17:06 ? 35次 阅读
TMS320C6746 TMS320C6746 Fixed/Floating Point DSP

OMAP-L138 OMAP-L138 Data Manual

OMAP-L138 C6000 DSP+ARM 处理器 是一款低功耗 应用 处理器,该处理器基于 ARM926EJ-S 和 C674x DSP 内核。该处理器 与其他 TMS320C6000™ 平台 DSP 相比,功耗要小很多。 凭借这款器件,原始设备制造商 (OEM) 和原始设计制造商 (ODM) 能够充分利用全集成混合处理器解决方案的灵活性,迅速将兼具稳健操作系统、丰富用户接口和高处理器性能的器件推向市场。 此器件采用双内核架构(包括一个高性能的 TMS320C674x DSP 内核和一个 ARM926EJ-S 内核),实现了 DSP 与精简指令集计算机 (RISC) 技术二者优势的完美融合。 ARM926EJ-S 是一款 32 位 RISC 处理器内核,可执行 32 位或 16 位指令和处理 32 位、16 位或 8 位数据。该内核采用流水线结构,因此处理器和存储器系统的所有部件能够连续运行。 ARM9 内核配有协处理器 15 (CP15)、保护模块以及具有页表缓冲区的数据和程序存储器管理单元 (MMU)。ARM9 内核配有独立的 16KB 指令缓存和 16KB 数据缓存。这两个缓存均与虚拟索引虚拟标签 (VIVT) 4 路相连。ARM9 内核还配...

发表于 10-15 17:04 ? 35次 阅读
OMAP-L138 OMAP-L138 Data Manual

TMS320C6748 TMS320C6748 Fixed/Floating Point DSP

TMS320C6748 定点和浮点 DSP 是一款低功耗 应用 处理器,该处理器基于 C674x DSP 内核。该DSP 与其他 TMS320C6000™ 平台 DSP 相比,功耗要小很多。 凭借这款器件,原始设备制造商 (OEM) 和原始设计制造商 (ODM) 能够充分利用全集成混合处理器解决方案的灵活性,迅速将兼具稳健操作系统、丰富用户接口和高处理器性能的器件推向市场。 该器件的 DSP 内核采用基于 2 级缓存的架构。第 1 级程序缓存 (L1P) 是一个 32KB 的直接映射缓存,第 1 级数据缓存 (L1D) 是一个 32KB 的 2 路组相连缓存。第 2 级程序缓存 (L2P) 包含 256KB 的存储空间,由程序空间和数据空间共享。L2 存储器可配置为映射存储器、缓存或二者的组合。尽管系统内的其他主机可访问 DSP L2,但还是额外提供了一个 128KB 的 RAM 共享存储器给其他主机使用,从而避免对 DSP 性能产生影响。 对于支持安全功能的器件,TI 的基本安全启动可为用户保护自主知识产权并防止外部实体修改用户开发的算法。该安全启动流程从一个基于硬件的“信任根”开始,确保代码从一个已知安全的位置开始...

发表于 10-15 16:19 ? 34次 阅读
TMS320C6748 TMS320C6748 Fixed/Floating Point DSP

TMS320C6720 TMS320C6727B TMS320C6726B TMS320C6722B TMS320C6720 Floating-Point DSPs

The TMS320C672x is the next generation of Texas Instruments' C67x generation of high-performance 32-/64-bit floating-point digital signal processors. The TMS320C672x includes the TMS320C6727B, TMS320C6726B, TMS320C6722B, and TMS320C6720 devices.(1) Enhanced C67x+ CPU. The C67x+ CPU is an enhanced version of the C67x CPU used on the C671x DSPs. It is compatible with the C67x CPU but offers significant improvements in speed, code density, and floating-point performance per clock cycle. At 350 MHz, the CPU is capable of a maximum performance of 2800 MIPS/2100 MFLOPS by executing up to eight instructions (six of which are floating-point instructions) in parallel each cycle. The CPU natively supports 32-bit fixed-point, 32-bit single-precision floating-point, and 64-bit double-precision floating-point arithmetic. Efficient Memory System. The memory controller maps the la...

发表于 10-15 16:17 ? 41次 阅读
TMS320C6720 TMS320C6727B TMS320C6726B TMS320C6722B TMS320C6720 Floating-Point DSPs

TMS320C6727B TMS320C6727B TMS320C6726B TMS320C6722B TMS320C6720 Floating-Point DSPs

The TMS320C672x is the next generation of Texas Instruments' C67x generation of high-performance 32-/64-bit floating-point digital signal processors. The TMS320C672x includes the TMS320C6727B, TMS320C6726B, TMS320C6722B, and TMS320C6720 devices.(1) Enhanced C67x+ CPU. The C67x+ CPU is an enhanced version of the C67x CPU used on the C671x DSPs. It is compatible with the C67x CPU but offers significant improvements in speed, code density, and floating-point performance per clock cycle. At 350 MHz, the CPU is capable of a maximum performance of 2800 MIPS/2100 MFLOPS by executing up to eight instructions (six of which are floating-point instructions) in parallel each cycle. The CPU natively supports 32-bit fixed-point, 32-bit single-precision floating-point, and 64-bit double-precision floating-point arithmetic. Efficient Memory System. The memory controller maps the la...

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SM320C6415-EP 增强型产品定点数字信号处理器

TMS320C64x ?? DSP(包括SM320C6414-EP,SM320C6415-EP和SM320C6416-EP器件)是TMS320C6000中性能最高的定点DSP产品。 DSP平台。 SM320C64x ?? (C64x ??)设备是基于第二代高性能,先进的VelociTI ??德州仪器(TI)开发的超长指令字(VLIW)架构(VelociTI.2 ??),使这些DSP成为多通道和多功能应用的绝佳选择。 C64x ??是C6000的代码兼容成员?? DSP平台。 C64x器件在500 MHz时钟频率下具有高达4000万条指令/秒(MIPS)的性能,可为高性能DSP编程挑战提供经济高效的解决方案。 C64x DSP具有高速控制器的操作灵活性和阵列处理器的数字功能。 C64x DSP内核处理器有64个32位字长的通用寄存器和8个高度独立的功能单元?? 2个乘法器用于32位结果和6个算术逻辑单元(ALU)??使用VelociTI.2扩展。八个功能单元中的VelociTI.2扩展包括新指令,以加速关键应用程序的性能并扩展VelociTI架构的并行性。 C64x每周期可产生4个32位乘法累加(MAC),总计每秒2400万MAC(MMACS),或每周期8个8位MAC,总计4800 MMACS。 C64x DSP还具有特定于应...

发表于 10-15 11:06 ? 13次 阅读
SM320C6415-EP 增强型产品定点数字信号处理器

SMJ320C6701-SP 抗辐射V类浮点数字信号处理器

SMJ320C67x DSP是SMJ320C6000平台中的浮点DSP系列。 SMJ320C6701('C6701)器件基于德州仪器(TI)开发的高性能,先进的VelociTI超长指令字(VLIW)架构,使该DSP成为多通道和多功能应用的绝佳选择。凭借在140 MHz时钟频率下高达1千兆位每秒浮点运算(GFLOPS)的性能,'C6701为高性能DSP编程挑战提供了经济高效的解决方案。 'C6701 DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供四个浮点/定点ALU,两个定点ALU和两个浮点/定点乘法器。 'C6701每周期可以产生两个乘法累加(MAC),总计每秒3.34亿MAC(MMACS)。 'C6701 DSP还具有专用硬件逻辑,片上存储器和额外的片上外设。 'C6701包含大量片上存储器,具有强大而多样的设置外围设备。程序存储器由64K字节块组成,用户可配置为高速缓存或存储器映射程序空间。数据存储器由两个32K字节的RAM块组成。外设集包括两个多通道缓冲串行端口(McBSP),两个通用定时器,一个主机端口接口(HPI)和...

发表于 10-09 15:12 ? 19次 阅读
SMJ320C6701-SP 抗辐射V类浮点数字信号处理器

TMS320VC5409A定点c

TMS320VC5409A定点数字信号处理器(DSP)(以下简称5409A除非另有说明)基于先进的改进型哈佛架构,有一个程序存储器总线和三个数据存储器总线。该处理器提供具有高度并行性的算术逻辑单元(ALU),专用硬件逻辑,片上存储器和其他片上外设。该DSP的操作灵活性和速度的基础是高度专业化的指令集。 独立的程序和数据空间允许同时访问程序指令和数据,提供高度的并行性。可以在单个周期中执行两个读操作和一个写操作。具有并行存储和特定于应用程序的指令的指令可以充分利用该架构。此外,数据可以在数据和程序空间之间传输。这种并行性支持一组强大的算术,逻辑和位操作操作,这些操作都可以在一个机器周期中执行。 5409A还包括管理中断的控制机制, 特性 具有三个独立的16位数据存储器总线和一个程序存储器总线的高级多总线架构 40位算术逻辑单元(ALU)包括一个40位桶形移位器和两个独立的40位累加器 17- \ xD7 17位并行乘法器耦合到一个40位专用加法器,用于非流水线单周期乘法/累积(MAC)操作 比较,选择和存储单位(CSSU)以进行...

发表于 10-09 11:40 ? 4次 阅读
TMS320VC5409A定点c

SM320VC5510A-EP 增强型产品定点数字信号处理器

The 320VC5510 (5510) fixed-point digital signal processor (DSP) is based on the TMS320C55x DSP generation CPU processor core. The C55x? DSP architecture achieves high performance and low power through increased parallelism and total focus on reduction in power dissipation. The CPU supports an internal bus structure composed of one program bus, three data-read buses, two-data write buses, and additional buses dedicated to peripheral and DMA activity. These buses provide the ability to perform up to three data reads and two data writes in a single cycle. In parallel, the DMA controller can perform up to two data transfers per cycle independent of the CPU activity. The C55x CPU provides two multiply-accumulate (MAC) units, each capable of 17-bit x 17-bit multiplication in a single cycle. A central 40-bit arithmetic/logic unit (ALU) is supported by an additional 16-bit ALU. Use of the ALUs is under instruc...

发表于 10-09 11:37 ? 32次 阅读
SM320VC5510A-EP 增强型产品定点数字信号处理器

SM320C6712D-EP 增强型产品浮点 DSP

320C67x ?? DSP(包括SM320C6712-EP,SM320C6712C-EP,SM320C6712D-EP器件)是浮动的成员TMS320C6000中的点DSP系列?? DSP平台。 C6712,C6712C和C6712D器件基于德州仪器(TI)开发的高性能,先进的超长指令字(VLIW)架构,使这些DSP成为多通道和多功能应用的绝佳选择。 p> C6712C /C6712D器件在时钟频率为167 MHz时性能高达10亿次浮点运算(MFLOPS),是C6000中成本最低的DSP? DSP平台。 C6712C /C6712D DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供四个浮点/定点ALU,两个定点ALU和两个浮点/定点乘法器。 C6712C /C6712D每个周期可以产生两个MAC,总计300 MMACS。 C6712在时钟频率为100 MHz时性能高达6亿次每秒浮点运算(MFLOPS)。该器件还为高性能DSP编程挑战提供了经济高效的解决方案。 C6712 DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个...

发表于 10-09 10:35 ? 52次 阅读
SM320C6712D-EP 增强型产品浮点 DSP

SM320C6711D-EP 增强型产品浮点 DSP

320C67x ?? DSP(包括SM320C6711-EP,SM320C6711B-EP,SM320C6711C-EP,SM320C6711D-EP器件)撰写TMS320C6000中的浮点DSP系列?? DSP平台。 C6711,C6711B,C6711C和C6711D器件基于德州仪器(TI)开发的高性能,先进的超长指令字(VLIW)架构,使这些DSP成为多通道和多功能应用的绝佳选择。 C6711 /C6711B器件的时钟频率为150 MHz,性能高达每秒9亿次浮点运算(MFLOPS),可为高性能DSP编程挑战提供经济高效的解决方案。 C6711 /C6711B DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供四个浮点/定点ALU,两个定点ALU和两个浮点/定点乘法器。 C6711 /C6711B每个周期可以产生两个MAC,总计300 MMACS。 在200 MHz或1350 MFLOPS的时钟频率下,每秒浮点运算高达12亿次(MFLOPS) C6711C /C6711D器件的时钟频率为250 MHz(适用于6711D),还为高性能DSP编程挑战提供了经济高效的解决方案。 C6711C /C6711D DSP还具有高速...

发表于 10-09 10:33 ? 0次 阅读
SM320C6711D-EP 增强型产品浮点 DSP

AM5706 Sitara 处理器:成本经优化的 Arm A15 和 DSP 以及安全引导

AM570x Sitara ARM应用处理器旨在满足现代嵌入式产品对于处理性能的强烈需求。 AM570x器件通过其极具有活性的全集成混合处理器解决方案,可实现较高的处理性能。此外,这些器件还将可编程的视频处理功能与高度集成的外设集完美融合。 可编程性通过单核ARM Cortex-A15 RISC CPU并借助Neon™扩展和TI C66x VLIW浮点DSP内核实现。借助ARM处理器,开发人员能够将控制函数与在DSP和协处理器上编程的其他算法分离其中,TI为ARM和C66x DSP提供了一系列完整的开发工具,其中包括C语言编译器AM570x Sitara ARM应用处理器专为满足现代嵌入式产品的强烈处理需求而打造。 AM570x器件通过集成的混合处理器解决方案的最大灵活性,带来高处理性能。这些器件还将可编程视频处理与高度集成的外设集相结合。 可编程性由具有Neon™扩展和TI C66x VLIW浮点DSP内核的单核ARM Cortex-A15 RISC CPU提供。 ARM处理器使开发人员能够将控制功能与DSP和协处理器上编程的视觉算法分开,从而降低系统软件的复杂性。 此外,TI还为A...

发表于 10-08 15:30 ? 43次 阅读
AM5706 Sitara 处理器:成本经优化的 Arm A15 和 DSP 以及安全引导

SMJ320C6701 军用浮点数字信号处理器

SMJ320C67x DSP是SMJ320C6000平台中的浮点DSP系列。 SMJ320C6701(?? C6701)器件基于德州仪器(TI)开发的高性能,先进的VelociTI超长指令字(VLIW)架构,使该DSP成为多通道和多功能应用的绝佳选择。 。凭借167 MHz时钟频率,每秒高达1千兆位浮点运算(GFLOPS)的性能,?? C6701为高性能DSP编程挑战提供了经济高效的解决方案。 ?? C6701 DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供四个浮点/定点ALU,两个定点ALU和两个浮点/定点乘法器。 ?? C6701每周期可以产生两个乘法累加(MAC),总共每秒3.34亿MAC(MMACS)。 ?? C6701 DSP还具有专用硬件逻辑,片上存储器和额外的片上外设。 ?? C6701包含大量片上存储器,具有强大的功能。各种外围设备。程序存储器由64K字节块组成,用户可配置为高速缓存或存储器映射程序空间。数据存储器由两个32K字节的RAM块组成。外设集包括两个多通道缓冲串行端口(McBSP),两个通用定时器,一个主机端口接口(HPI)和一个无缝外部...

发表于 09-29 11:49 ? 42次 阅读
SMJ320C6701 军用浮点数字信号处理器

AM5K2E02 多核 ARM+DSP

AM5K2E0x是一款基于TI的KeyStone II多核SoC架构的高性能器件,该器件集成了性能最优的Cortex-A15处理器双核或四核CorePac可以高达1.4GHz的内核速度运行.TI的AM5K2E0x器件实现了一套易于使用的高性能,低功耗平台,可供企业级网络终端设备,数据中心网络,航空电子设备和国防,医疗成像,测试和自动化等诸多应用领域的开发人员使用。 TI的KeyStone II架构提供了一套集成有ARM CorePac,(Cortex-A15处理器四核CorePac),网络处理等各类子系统的可编程平台,并且采用了基于队列的通信系统,使得器件资源能够高效且无缝地运作。这种独特的器件架构中还包含一个TeraNet交换机,该交换机可能从可编程内核到高速IO的各类系统元素广泛融合,确保它们以最高效率持续运作。 AM5K2E0x KeyStone II器件集成了大量的片上存储ARMD CorePac中多达4个Cortex A15内核共享4MB L2缓存。该器件还集成了2MB的多核共享存储器(每个MSMC),可用作共享的L3 SRAM。所有L2和MSMC存储器均包含错误检测与错误校正功能。该器件包含一个以1600MTPS传输速率运行的64位DDR-3...

发表于 09-29 11:42 ? 0次 阅读
AM5K2E02 多核 ARM+DSP

SMJ320C6201B 定点数字信号处理器,军事

320C6201B DSP是320C6000平台中定点DSP系列的成员。 SM /SMJ320C6201B(C6201B)器件基于德州仪器(TI)开发的高性能,先进的VelociTI超长指令字(VLIW)架构,使该DSP成为多通道和多功能应用的绝佳选择。 。 C6201B的时钟频率为200 MHz,性能高达1.6亿次/秒(MIPS),为高性能DSP编程挑战提供了经济高效的解决方案。 C6201B是C6201的较新版本。 C6201B DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供六个算术逻辑单元(ALU)以实现高度并行性,两个16位乘法器提供32位结果。 C6201B每个周期可以产生两个乘法累加(MAC) - 总计每秒4亿MAC(MMACS)。 C6201B DSP还具有专用硬件逻辑,片上存储器和其他片上外设。 C6201B包含大量片上存储器,并具有功能强大且多样化的外设集。程序存储器由64K字节块组成,用户可配置为高速缓存或存储器映射程序空间。 C6201B的数据存储器由两个32K字节的RAM块组成,以提高并发性。外设集包括两个多通道缓冲串行端口(McBSP),两个...

发表于 09-29 11:40 ? 12次 阅读
SMJ320C6201B 定点数字信号处理器,军事

AM5708 Sitara 处理器:成本经优化的 Arm A15 和 DSP,多媒体和安全引导

AM570x Sitara ARM应用处理器旨在满足现代嵌入式产品对于处理性能的强烈需求。 AM570x器件通过其极具有活性的全集成混合处理器解决方案,可实现较高的处理性能。此外,这些器件还将可编程的视频处理功能与高度集成的外设集完美融合。 可编程性通过单核ARM Cortex-A15 RISC CPU并借助Neon™扩展和TI C66x VLIW浮点DSP内核实现。借助ARM处理器,开发人员能够将控制函数与在DSP和协处理器上编程的其他算法分离其中,TI为ARM和C66x DSP提供了一系列完整的开发工具,其中包括C语言编译器AM570x Sitara ARM应用处理器专为满足现代嵌入式产品的强烈处理需求而打造。 AM570x器件通过集成的混合处理器解决方案的最大灵活性,带来高处理性能。这些器件还将可编程视频处理与高度集成的外设集相结合。 可编程性由具有Neon™扩展和TI C66x VLIW浮点DSP内核的单核ARM Cortex-A15 RISC CPU提供。 ARM处理器使开发人员能够将控制功能与DSP和协处理器上编程的视觉算法分开,从而降低系统软件的复杂性。 此外,TI还为A...

发表于 09-29 11:35 ? 109次 阅读
AM5708 Sitara 处理器:成本经优化的 Arm A15 和 DSP,多媒体和安全引导

SMJ320VC33 数字信号处理器

SMx320VC33 DSP是一款采用0.18μm四电平CMOS(TImeline)技术制造的32位浮点处理器。 SMx320VC33是德州仪器(TI)SM320C3x™系列DSP的一部分。 SM320C3x内部总线和特殊数字信号处理指令集具有高达150 MFLOPS的速度和灵活性。 SMx320VC33通过在其他处理器通过软件或微代码实现的硬件中实现功能来优化速度。这种硬件密集型方法提供了以前在单个芯片上不可用的性能。 SMx320VC33可以在一个周期内对整数或浮点数据执行并行乘法和ALU运算。每个处理器还拥有通用寄存器文件,程序高速缓存,专用ARAU,内部双访问存储器,支持并发I /O的一个DMA通道以及较短的机器周期时间。这些特征导致高性能和易用性。大地址空间,多处理器接口,内部和外部生成的等待状态,一个外部接口端口,两个定时器,一个串行端口和多中断结构大大增强了通用应用程序。 SM320C3x支持从主处理器到专用协处理器的各种系统应用程序。通过基于寄存器的架构,大地址空间,强大的寻址模式,灵活的指令集以及良好支持的浮点运算,可轻松实现高级语言支持。 SM /SMJ320VC33是一...

发表于 09-29 11:26 ? 80次 阅读
SMJ320VC33 数字信号处理器

SMJ320VC5416 SMJ320VC5416 定点 DSP

SMJ320VC5416定点数字信号处理器(DSP)(以下简称5416除非另有说明)基于先进的改进型哈佛架构,有一个程序存储器总线和三个数据存储器总线。该处理器提供具有高度并行性的算术逻辑单元(ALU),专用硬件逻辑,片上存储器和其他片上外设。该DSP的操作灵活性和速度的基础是高度专业化的指令集。 独立的程序和数据空间允许同时访问程序指令和数据,提供高度的并行性。可以在单个周期中执行两个读操作和一个写操作。具有并行存储和特定于应用程序的指令的指令可以充分利用该架构。此外,数据可以在数据和程序空间之间传输。这种并行性支持一组强大的算术,逻辑和位操作操作,这些操作都可以在一个机器周期中执行。 5416还包括管理中断,重复操作和函数调用的控制机制。 特性 处理至MIL-PRF-38535(QML) 具有三个独立的16位数据存储器总线的高级多总线架构和一个程序存储器总线 40位算术逻辑单元(ALU),包括一个40位桶形移位器和两个独立的40位累加器 17 x 17位并行乘法器耦合用于非流水线单周期乘法/累加(MAC)操作的40位专用加法器...

发表于 09-29 11:05 ? 25次 阅读
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